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Memory Configuration
Program
X Data
Y Data
$FFFFFF
Internal
$FFFFFF
$FFFF80
$FFF000
Internal I/O
External
$FFFFFF
$FFFFC0
$FFFF80
$FFF000
External I/O
Internal I/O
External
Reserved
Internal
Internal
$FF00C0
$FF0000 Bootstrap ROM $FF0000
Reserved
$FF0000
Reserved
$018000
External
External
External
Reserved
$00C000
$00C000
$00C000
Internal
Program RAM
$00A000
Reserved
$00A000
Reserved
$000400
$000000
47K
Reserved
$000000
Internal X data
RAM 40K
$000000
Internal Y data
RAM 40K
Bit Settings
Memory Configuration
MS
1
MSW
[1:0]
11
CE
1
SC
0
Program RAM
47K
X Data RAM*
40K
Y Data RAM*
40K
Cache
Enabled
Addressable
Memory Size
16 M
$0400 – $BFFF
$0000 – $9FFF
$0000 – $9FFF
? Lowest 10K of X data RAM and 10K of Y data RAM are shared memory that can be accessed by the core and the
EFCOP but not by the DMA controller.
Figure 3-10. Memory Switch On (MSW = 11), Cache On, 24-Bit Mode
DSP56311 User’s Manual, Rev. 2
3-18
Freescale Semiconductor
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